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2006-12-0413:30:06 星期一

 锁相环失锁问题探讨

   



问:

在电子工程论坛上看到您的留言,我现在的问题也是关于锁相环的,所以想请教一下,我在14脚输入50赫 兹的方波,想得到1。8k的方波,用鉴相器2,CD4046参数分别是c1,10000p, R1,20k, 滤波电阻R3,10M, C100000p, R100k
现在的问题是,不知道为什么,总是锁不上,1脚总是有负脉冲,14脚和3脚之间总是有相位差,4脚的输出频率基本上可以正确得到,就是有一些不稳
后来就改参数,发现越来越不对,改回去效果也更不好了,不知道为什么啊!!!!
能帮我看看问题出在哪里吗???还有是不是环路滤波器的设计有问题啊!!!
具体怎么样设计那???有没有什么相关的小例子可以参考一下吗??
做了好长时间了,不知道该怎么办了!!
谢谢您了!!!

答:

不好意思,我对分立器件的PLL不是很熟悉,不过我查了一下摩托罗拉的MC14 046的手册,看起来似乎是环路滤波器的问题。你可以到
http://www.21icsearch.com/
下载MC14046的手册,其中最后两页有一些设计参考

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网友: jacky
2006-12-05 22:37
 
评论:

老大 能否针对各模块对锁相环的相噪的影响进行一下总结,感觉现在看的资料很难在脑子里建立起系统的概念。还有电源噪声和衬底噪声在电路仿真时该如何建模,感觉很难将这些噪声抽象出来做为一个噪声信号源。另外spectre仿pss时好像无法仿非周期信号,这个该如何仿真,能否介绍一下。

 
网友: 卷积云
2006-12-11 20:37
 
评论: to jacky: 谢谢捧场!回答参见新发表的帖子。
 

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